用一片同步计数器74LS169和一片8选1数据选择器74LS151 设计一个输出序列为01001100010111的序列信号发生器
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用一片同步计数器74LS169和一片8选1数据选择器74LS151，设计一个输出序列为01001100010111的序列信号发生器，画出逻辑图。
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序列长度是14，应将74LS169连接为模14的计数器。为不使用外加逻辑门，计数器采用加计数且使用进位输出端进行同步预置。
由于74LS169为同步预置，预置值应为0010，计数状态为0010，0011，…，1110，1111。根据所使用计数状态列出如表所示的输出序列F的真值表。
输出函数的真值表
QD QC QB QA F 0
0
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0
1
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1
1
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1 0
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1
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由真值表得到输出序列卡诺图如图所示。
选QDQCQB作为地址，可以得至0：D0=0，D1=QA，D2=0，D3=1，D4=0，D5=QA，D6=QA，D7=1。
逻辑图如图所示。
