设计一个判断4位二进制数A3A2A1A0状态的组合逻辑电路。要求： （1)当能被5整除时 输出F0=1 否则F0=0 （2)当A3
逻辑,电路,状态
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设计一个判断4位二进制数A3A2A1A0状态的组合逻辑电路。要求：
(1)当能被5整除时，输出F0=1，否则F0=0
(2)当A3A2A1A0小于3时，输出F1=1，否则F1=0；A3A2A1A0作为输入逻辑变量，F1、F0作为输出逻辑变量。要求用ROM实现，并画出简图。
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真值表如下表所示。
真值表
地址输入数据输出A3
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1A2
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1A1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1A0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1F1
1
1
1
0
0
0
0
0
0
0
0
0
0
0
0
0F0
1
0
0
0
0
1
0
0
0
0
1
0
0
0
0
1
由表可得
F0=m0+m5+m10+m15
F1=m0+m1+m2
把地址A3A2A1A0作为地址输入变量，F1、F0作为输出变量，画出ROM电路如下图所示。
