用D触发器实现2倍分频的Verilog描述？ （汉王笔试）
汉王,分频,触发器
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用D触发器实现2倍分频的Verilog描述？ （汉王笔试）
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正确答案：
module divide2( clk , clk_o, reset);
ｉｎｐｕｔ clk , reset;
output clk_o;
wire in;
reg out ;
always @ ( posedge clk or posedge reset)
if ( reset)
out <= 0;
else
out <= in;
assign in = ~out;
assign clk_o = out;
endmodule