依据Mealy型状态机设计过程 选择正确的程序填入空白处：module FSM_1 （input clk input rst_n
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依据Mealy型状态机设计过程，选择正确的程序填入空白处：module FSM_1 （input clk , input rst_n ,input [1:0] in1 ,input [1:0] in2,output reg [1:0] out );param eter S0= 4"b0001, S1= 4"b0010, S2 = 4"b0100, S3= 4"b1000 ,reg [3:0] state ; always@（posedge clk or negedge rst_n)begin if（!rst_n) ; else case（state) S0: begin if（in2==1) ; else out<= 1; if（in1==1) state <= S1; else state <= S0; end S1:begin if（in2==1) out<= 0; else out<= 1; if（in1==1) state <= S1; el
A．state <= S0； out<= 0;
B．rst_n <= S0； out<= 0;
C．state <= S1； out<= 1;
D．rst_n <= S0； state <= 0;
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