已知时钟信号clkin的频率为100MHz的方波信号 下面程序中clkout的频率为（）。 module function（rst
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已知时钟信号clkin的频率为100MHz的方波信号，下面程序中clkout的频率为（）。 module function（rst, clkin, clkout); input clkin, rst; output wire clkout; reg[2:0] m, n; reg clk1, clk2; assign clkout=clk1|clk2; always @（posedge clkin) begin if（!rst) begin clk1<=0; m<=0; end else begin if（m==4) m<=0; else m<=m+1; if（m<2) clk1<=1; else clk1<=0; end end always @（negedge clkin) begin if（!rst) begin clk2<=0; n=0; end else begin if（n==4) n<=0; else n<=n+1
A．10MHz
B．25MHz
C．20MHz
D．50MHz
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20MHz