已知时钟信号clkin的频率为100MHz的方波信号 下面程序中clk1信号的占空比为50% module function（
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已知时钟信号clkin的频率为100MHz的方波信号，下面程序中clk1信号的占空比为50% module function（rst, clkin, clk1); input clkin, rst; output clk1; reg[2:0] m, n; reg clk1; always @（posedge clkin) begin if（!rst) begin clk1<=0; m<=0; end else begin if（m==4) begin m<=0; clk1<=~clk1;end else m<=m+1; end end endmodule
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20MHz